杭州松下家用电器微电子笔试试题及答案

FPGA和ASIC的概念，他们的区别。
　　 答案：FPGA是可编程ASIC。
　　 ASIC:专用集成电路，它是面向专门用途的电路，专门为一个用户设计和制造的。根据一个用户的特 定要求，能以低研制成本，短、交货周期供货的全定制，半定制集成电路。与门阵列等其它ASIC

(Application Specific IC)相比，它们又具有设计开发周期短、设计制造成本低、开发工具先进、标准产品无需测试、质量稳定以及可实时在线检验等优点.


2. 建立时间是指触发器的时钟信号上升沿到来以前，数据稳定不变的时间。输入信号应

提前时钟上升沿（如上升沿有效）T时间到达芯片，这个T就是建立时间-Setup time.如不满足setuptime,这个数据就不能被这一时钟打入触发器，只有在下一个时钟上升沿，数据才能被打入触发器。保持时间是指触发器的时钟信号上升沿到来以后，数据稳定不变的时间。如果hold time不够，数据同样不能被打入触发器。
建立时间是指在时钟边沿前，数据信号需要保持不变的时间。保持时间是指时钟跳变边沿后数据信号需要
保持不变的时间。如果不满足建立和保持时间的话，那么DFF将不能正确地采样到数据，将会出现stability（亚稳态）的情况。如果数据信号在时钟沿触发前后持续的时间均超过建立和保持时间，那么超过量就分别被称为建立时间裕量和保持时间裕量。

3. 什么是竞争与冒险现象？怎样判断？如何消除？（汉王笔试）
在组合逻辑中，由于门的输入信号通路中经过了不同的延时，导致到达该门的时间不一致叫竞争。

产生毛刺叫冒险。如果布尔式中有相反的信号则可能产生竞争和冒险现象。解决方法：一是添加布尔式的

消去项，二是在芯片外部加电容。
4. 列举几种集成电路典型工艺。工艺上常提到0.25,0.18指的是什么？（仕兰微面试题

目）制造工艺：我们经常说的0.18微米、0.13微米制程，就是指制造工艺了。制造工艺直接关系到cpu的

电气性能。而0.18微米、0.13微米这个尺度就是指的是cpu核心中线路的宽度。线宽越小，cpu的功耗和发

热量就越低，并可以工作在更高的频率上了。所以以前0.18微米的cpu最高的频率比较低，用0.13微米制

造工艺的cpu会比0.18微米的制造工艺的发热量低都是这个道理了。
5. 集成电路前段设计流程，写出相关的工具。（扬智电子笔试）
先介绍下IC开发流程：
1.）代码输入（design input)
用vhdl或者是verilog语言来完成器件的功能描述，生成hdl代码
语言输入工具：SUMMIT VISUALHDL
MENTOR RENIOR
图形输入: composer(cadence);
viewlogic (viewdraw)
2.）电路仿真（circuit simulation)
将vhd代码进行先前逻辑仿真，验证功能描述是否正确
数字电路仿真工具：
Verolog： CADENCE Verolig-XL
SYNOPSYS VCS
MENTOR Modle-sim
VHDL : CADENCE NC-vhdl
SYNOPSYS VSS
MENTOR Modle-sim
模拟电路仿真工具：
***ANTI HSpice pspice，spectre micro microwave: eesoft : hp
3.）逻辑综合（synthesis tools)
逻辑综合工具可以将设计思想vhd代码转化成对应一定工艺手段的门级电路；将初级仿真中所没有

考虑的门沿（gates delay）反标到生成的门级网表中,返回电路仿真阶段进行再仿真。最终仿真结果生成

的网表称为物理网表。
7、解释setup和hold time violation，画图说明，并说明解决办法。（威盛VIA 2003.11.10上海笔试试

题）
Setup/hold time是测试芯片对输入信号和时钟信号之间的时间要求。建立时间是指触发器的时钟信号上

升沿到来以前，数据稳定不变的时间。输入信号应提前时钟上升沿（如上升沿有效）T时间到达芯片，这

个T就是建立时间-Setup time.如不满足setup time,这个数据就不能被这一时钟打入触发器，只有在下一

个时钟上升沿，数据才能被打入触发器。保持时间是指触发器的时钟信号上升沿到来以后，数据稳定不变

的时间。如果hold time不够，数据同样不能被打入触发器。
建立时间(Setup Time)和保持时间（Hold time）。建立时间是指在时钟边沿前，数据信号需要保持不变

的时间。保持时间是指时钟跳变边沿后数据信号需要保持不变的时间。如果不满足建立和保持时间的话，

那么DFF将不能正确地采样到数据，将会出现stability的情况。如果数据信号在时钟沿触发前后持续的时

间均超过建立和保持时间，那么超过量就分别被称为建立时间裕量和保持时间裕量。
6、什么是竞争与冒险现象？怎样判断？如何消除？（汉王笔试）
在组合逻辑中，由于门的输入信号通路中经过了不同的延时，导致到达该门的时间不一致叫竞争。产生毛

刺叫冒险。如果布尔式中有相反的信号则可能产生竞争和冒险现象。解决方法：一是添加布尔式的消去项

，二是在芯片外部加电容。
7、如何解决亚稳态。（飞利浦－大唐笔试）
亚稳态是指触发器无法在某个规定时间段内达到一个可确认的状态。当一个触发器进入亚稳态时，既无法

预测该单元的输出电平，也无法预测何时输出才能稳定在某个正确的电平上。在这个稳定期间，触发器输

出一些中间级电平，或者可能处于振荡状态，并且这种无用的输出电平可以沿信号通道上的各个触发器级

联式传播下去。
解决方法：
1降低系统时钟频率
2用反应更快的FF
3引入同步机制，防止亚稳态传播
4改善时钟质量，用边沿变化快速的时钟信号
关键是器件使用比较好的工艺和时钟周期的裕量要大。
8、IC设计中同步复位与异步复位的区别。（南山之桥）
同步复位在时钟沿采复位信号，完成复位动作。异步复位不管时钟，只要复位信号满足条件，就完成复

位动作。异步复位对复位信号要求比较高，不能有毛刺，如果其与时钟关系不确定，也可能出现亚稳态。
9、多时域设计中,如何处理信号跨时域。（南山之桥）
不同的时钟域之间信号通信时需要进行同步处理，这样可以防止新时钟域中第一级触发器的亚稳态信号

对下级逻辑造成影响，其中对于单个控制信号可以用两级同步器，如电平、边沿检测和脉冲，对多位信号

可以用FIFO,双口RAM，握手信号等。
跨时域的信号要经过同步器同步，防止亚稳态传播。例如：时钟域1中的一个信号，要送到时钟域2，那么

在这个信号送到时钟域2之前，要先经过时钟域2的同步器同步后，才能进入时钟域2。这个同步器就是两

级d触发器，其时钟为时钟域2的时钟。这样做是怕时钟域1中的这个信号，可能不满足时钟域2中触发器的

建立保持时间，而产生亚稳态，因为它们之间没有必然关系，是异步的。这样做只能防止亚稳态传播，但

不能保证采进来的数据的正确性。所以通常只同步很少位数的信号。比如控制信号，或地址。当同步的是

地址时，一般该地址应采用格雷码，因为格雷码每次只变一位，相当于每次只有一个同步器在起作用，这

样可以降低出错概率，象异步FIFO的设计中，比较读写地址的大小时，就是用这种方法。 如果两个时钟

域之间传送大量的数据，可以用异步FIFO来解决问题。
10、给了reg的setup,hold时间，求中间组合逻辑的delay范围。（飞利浦－大唐笔试）
Delay < period - setup–hold
11、时钟周期为T,触发器D1的寄存器到输出时间最大为T1max，最小为T1min。组合逻辑电路最大延迟为

T2max,最小为T2min。问，触发器D2的建立时间T3和保持时间应满足什么条件。（华为）
T3setup>T T2max,T3hold>T1min T2min
12、说说静态、动态时序模拟的优缺点。（威盛VIA 2003.11.10上海笔试试题）
静态时序分析是采用穷尽分析方法来提取出整个电路存在的所有时序路径，计算信号在这些路径上的传播

延时，检查信号的建立和保持时间是否满足时序要求，通过对最大路径延时和最小路径延时的分析，找出

违背时序约束的错误。它不需要输入向量就能穷尽所有的路径，且运行速度很快、占用内存较少，不仅可

以对芯片设计进行全面的时序功能检查，而且还可利用时序分析的结果来优化设计，因此静态时序分析已

经越来越多地被用到数字集成电路设计的验证中。
动态时序模拟就是通常的仿真，因为不可能产生完备的测试向量，覆盖门级网表中的每一条路径。因此在

动态时序分析中，无法暴露一些路径上可能存在的时序问题；
13、同步电路和异步电路的区别是什么？
同步电路：存储电路中所有触发器的时钟输入端都接同一个时钟脉冲源，因而所有触发器的状态的变化都

与所加的时钟脉冲信号同步。
异步电路：电路没有统一的时钟，有些触发器的时钟输入端与时钟脉冲源相连，这有这些触发器的状态变

化与时钟脉冲同步，而其他的触发器的状态变化不与时钟脉冲同步。
14、什么是NMOS、PMOS、CMOS？什么是增强型、耗尽型？什么是PNP、NPN？他们有什么差
别？
MOS场效应管即金属-氧化物-半导体型场效应管，英文缩写为MOSFET（l-Oxide-Semiconductor Field-

Effect-Transistor），属于绝缘栅型。其主要特点是在金属栅极与沟道之间有一层二氧化硅绝缘层，因

此具有很高的输入电阻（最高可达1015Ω）。它也分N沟道管和P沟道管，符号如图1所示。通常是将衬底

（基板）与源极S接在一起。根据导电方式的不同，MOSFET又分增强型、耗尽型。所谓增强型是指：当

VGS=0时管子是呈截止状态，加上正确的VGS后，多数载流子被吸引到栅极，从而“增强”了该区域的载流

子，形成导电沟道。耗尽型则是指，当VGS=0时即形成沟道，加上正确的VGS时，能使多数载流子流出沟道

，因而“耗尽”了载流子，使管子转向截止。
PNP与NPN的区别在表面上是以PN结的方向来定义的，实际上是以三极管的结构材料来区分的。PNP是两边

的棒料是镓，中间的是硅。镓是第三主族的元素，其核外为三个电子，硅是第四主族的元素，其核外有四

个电子，这样在两个PN的方向上的顺序是P－N－N的关系；相反NPN是两边的材料是硅，中间的是镓，形成

的PN结顺序为N－P－N的关系。
顺便说明：P的意思是在PN结上缺少电子，以空穴为主导电的材料，也叫P型材料；N的意思是在PN结上有

多余的电子，以电子为主导电的材料，也叫N型材料。
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1设计原理
系统设计框图如图1所示。

根据不同分频系数设置适当的计数器周期，每个计数值对应输入时钟信号fi的一个周期，让q0只在fi的上

升沿及适当的计数范围内产生高电平，最后将q0和q1进行逻辑或操作，进而得到所需的分频信号fo。q1的

作用是在奇数分频中补足下降沿处半个时钟周期，使其等占空比，以及在半整数分频中，在时钟下降沿处

产生分频信号的上升沿，以实现半整数分频。

下面介绍如何确定计数器周期以及q0、q1产生高电平输出时各自的计数范围。为叙述方便，现规定如下标

记：分频系数为divide（MAX downto 0），其中MAX是分频数对应二进制数的最高位，对于半整数分频，

最低位即第0位为小数位；q 0_count和q1_count分别为q0和q1产生高电平的计数范围，并记divide（MAX

downto 1）为a，divide（MAX downto 2）为b，divide（MAX downto 0）－1为c。

1.1偶数及奇数分频

计数器周期都为0到c。等占空比的偶数分频很容易实现，在此不加叙述。对奇数分频，只需当q0_count＜

a时q0输出高电平，当q1_count＝a－1时q1输出一个周期的高电平，其他情况下q0和q1都为低电平，然后

把q0和q1逻辑或，所得的输出fo就是所需的基数分频时钟信号。

1.2半整数分频
计数器周期为0到c。如果整数部分是偶数，只需当q0_count＜b时q0输出高电平，当b≤q1_count＜a＋b时

q1输出高电平，其他情况下，q0和q1都为低电平；如果整数部分是奇数，只需当q0_coun≤b时q0输出高电

平，当b≤q1_count≤a＋b输出高电平，其他情况下q0和q1都为低电平，然后把q0和q1逻辑或所得输出f0

即所需的半整数分频时钟信号。
latch与DFF的区别
收集了一下网上资源，总结如下：
1、latch由电平触发，非同步控制。在使能信号有效时latch相当于通路，在使能信号无效时latch保持输

出状态。DFF由时钟沿触发，同步控制。
2、latch容易产生毛刺（glitch），DFF则不易产生毛刺。
3、如果使用门电路来搭建latch和DFF，则latch消耗的门资源比DFF要少，这是latch比DFF优越的地方。

所以，在ASIC中使用latch的集成度比DFF高，但在FPGA中正好相反，因为FPGA中没有标准的latch单元，

但有DFF单元，一个LATCH需要多个LE才能实现。
4、latch将静态时序分析变得极为复杂。
一般的设计规则是：在绝大多数设计中避免产生latch。它会让您设计的时序完蛋，并且它的隐蔽性很

强，非老手不能查出。latch最大的危害在于不能过滤毛刺。这对于下一级电路是极其危险的。所以，只

要能用D触发器的地方，就不用latch。
有些地方没有时钟，也只能用latch了。比如现在用一个clk接到latch的使能端(假设是高电平使能),

这样需要的setup时间，就是数据在时钟的下降沿之前需要的时间，但是如果是一个DFF，那么setup时间

就是在时钟的上升沿需要的时间。这就说明如果数据晚于控制信号的情况下，只能用latch,这种情况就是

，前面所提到的latch timing borrow。基本上相当于借了一个高电平时间。也就是说，latch借的时间也

是有限的。
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笔试中的数学推理/数字推理技巧
1, 6, 25, 62, ()
解：123 x^3-2
4, 4, 6, 12, 30, ( ) ？
解：(4,4) (6,12) (30,90)
1 2 3
4*1 = 4
4*1.5=6
6*2=12
12*2.5 = 30
30*3=90
2 3 5 10 15
解：2 3=5
2 3 5=10
5 10=15
5 10 15=30

数字推理其实不难，每一道题目都有规律，寻找这个规律关键要从数列本身和四个备选答案出发，仔细观

察数列的项数多、少、，数字的大、小，以及数字自身有何特点，这样5秒内就可以确定正确的解题思路

。
下面用我讲的解题方法，来分析一下5道题目。
第41题：2 12 36 80 （ ）
A．100 B．125 C．150 D．175
拿到题目一眼可以看出四个选项中最大的数字和80相差不大，里面必然包含加法运算，而且题干中的数全

是偶数，就可以知道必须用组合或加法的变化。可以把此数列拆成2�1、3�4、4�9、5�16下一个必然

是6�25；故答案选C。
第42题： 1 3 4 1 9 （ ）
A．5 B．11 C．14 D．64
题目明显特征就是全是个位数，而且数字大小没规律，我在讲课中已讲到的，很明显就是减法的变化。相

邻两项的差的平方等于后一项。故选D。
第43题： 0 9 26 65 124 （ ）
A．165 B．193 C．217 D．239
这道题是老题，只不过稍加变化而已。就是立方规律的变化，每一项增加或减少1就构成了一个立方数列

。我讲稿上有这个例子。答案选C。
第44题： 0 4 16 40 80 （ ）
A．160 B．128 C．136 D．140
题目四个选项的最大数和80相差不大，故可以用减法，三级等差。答案选D。
第45题： 0 2 10 30 （ ）
A．68 B．74 C．60 D．70
这道题目项数比较少，选项和30相差不大，且都是偶�，规律非常明显，和第一题解题思路可以完全相同

。可以把此数列拆成0�1、1�2、2�5、3�10下一个必然是4�17；故答案选A。

　　数字推理题主要有以下几种题型:
　　1.等差数列及其变式
　　例题：1,4,7,10,13,()
　　A.14 B.15 C.16 D.17
　　答案为C。我们很容易从中发现相邻两个数字之间的差是一个常数3，所以括号中的数字应为16。等差

数列是数字推理测验中排列数字的常见规律之一。
　　例题：3,4,6,9,()，18
　　A.11 B.12 C.13 D.14
　　答案为C。仔细观察，本题中的相邻两项之差构成一个等差数列1,2,3,4,5.……，因此很快可以推算

出括号内的数字应为13,象这种相邻项之差虽不是一个常数，但有着明显的规律性，可以把它看作等差数

列的变式。
　　2.“两项之和等于第三项”型
　　例题：34,35,69,104,()
　　A.138 B.139 C.173 D.179
　　答案为C。观察数字的前三项，发现第一项与第二项相加等于第三项，3435=69，在把这假设在下一数

字中检验，3569=104，得到验证，因此类推，得出答案为173。前几项或后几项的和等于后一项是数字排

列的又一重要规律。
　　3.等比数列及其变式
　　例题：3，9，27，81，()
　　A.243 B.342 C.433 D.135
　　答案为A。这是最一种基本的排列方式，等比数列。其特点为相邻两项数字之间的商是一个常数。
　　例题：8，8，12，24，60，()
　　A.90 B.120 C.180 D.240
　　答案为C。虽然此题中相邻项的商并不是一个常数，但它们是按照一定规律排列的：1，1.5，2，2.5

，3，因此答案应为60�3=180,象这种题可视作等比数列的变式。
　　4.平方型及其变式
　　例题：1,4,9,()，25,36
　　A.10 B.14 C.20 D.16
　　答案为D。这道试题考生一眼就可以看出第一项是1的平方，第二项是2的平方，依此类推，得出第四

项为4的平方16。对于这种题，考生应熟练掌握一些数字的平方得数。如：
　　10的平方=100
　　11的平方=121
　　12的平方=144
　　13的平方=169
　　14的平方=196
　　15的平方=225
　　例题：66，83，102，123，()
　　A.144 B.145 C.146 D.147
　　答案为C。这是一道平方型数列的变式，其规律是8，9，10，11的平方后再加2，因此空格内应为12的

平方加2，得146。这种在平方数列的基础上加减乘除一个常数或有规律的数列，可以被看作是平方型数列

的变式，考生只要把握了平方规律，问题就可以化繁为简了。
　　5.立方型及其变式
　　例题：1，8，27，()
　　A.36 B.64 C.72 D.81
　　答案为B。解题方法如平方型。我们重点说说其变式
　　例题：0，6，24，60，120，()
　　A.186 B.210 C.220 D.226
　　答案为B。这是一道比较有难道的题目。如果你能想到它是立方型的变式，就找到了问题的突破口。

这道题的规律是第一项为1的立方减1，第二项为2的立方减2，第三项为3的立方减3，依此类推，空格处应

为6的立方减6，即210。
　　6.双重数列
　　例题：257，178，259，173，261，168，263，()
　　A.275 B.178 C.164 D.163
答案为D。通过观察，我们发现，奇数项数值均为大数，而偶数项都是小数。可以判断，这是两列数列交

替排列在一起而形成的一种排列方式。在这类题目中，规律不能在邻项中寻找，而必须在隔项中寻找，我

们可以看到，奇数项是一个等差数列，偶数项也是一个等差数列，因此不难发现空格处即偶数项的第四项

，应为163。也有一些题目中的两个数列是按不同的规律排列的，考生如果能判断出这是多组数列交替排

列在一起的数列，就找到了解题的关键。

　　这里介绍处理一类数字推理问题的一个常用技巧—变形。
　　所谓变形，就是将已知数列中的一些数转变形式，继而达到找到规律的目的。
　　32， 81， 64， 25， ( )， 1
　　 A。5 B。6 C。10 D。12
　　解答这道题目时，首先应注意到32，81， 64， 25这几个数字的特殊性，他们都是某个自然数的多少

次方， 32为2的5方，81为3的4次方，也是9的平方， 64为2的6次方，也是4的3次方，25为5的平方，那么

，我们要找规律的话，很自然想到要把这些数，换成几的几次方的形式以后会有什么规律，而32和25只能

表示成2的5次方和5的平方(也就是5的2次方)，所以我们就要把81和64变为3的几次方和4的几次方，这样

底数(即32为2的5方中的2)2，3，4，5变成为连续的自然数了。
　　也就是，我们把32， 81， 64， 25变形为2*2*2*2*2， 3*3*3*3，4*4*4，5*5，依次为5，4，3，2个

相同的数想乘，则下一个数肯定是1个6相乘，即6的1次方等于6，故选B。
　　总结一下，就是数字推理中，如果出现像25，81，121，343这种同一个数的方次的数(25为5的2次方

， 81为3的4次方，也为9的2次方，121为11的2次方，343为7的3次方)，我们就要想到把他们变形，再找

规律。
（1）65，35，17，＿，1；
（2）0，7，26，63，＿；
（3）3.02，4.03，3.05，9.10，＿；
（4）2，6，13，39，15，45，23，＿；
（5）15，27，59，＿103；
（6）95，88，71，61，50，__。
参考答案：（1）3；（2）124；（3）13.12；（4）69；（5）81；（6）40。

6 24 60 120 ( )
a 6 b 186 c 120 d 210

答案是D
2*3 4*6 6*10 8*15 (10*21)
======================================
看规律啊,前一位乘数以step=2递增,后一位乘数以step=1递增
数据推理题：一，1，1，2，6，24，（）答案：120
1*1=1 1*2=2 2*3=6 6*4=24 24*5=120


1)等差，等比这种最简单的不用多说，深一点就是在等差，等比上再加、减一个数列，如24,70,210,622

，规律为a*3-2=b
2)深一愕模珹，各数之间的差有规律，如 1、2、5、10、17。它们之间的差为1、3、5、7，成等差数列。

这些规律还有差之间成等比之类。B，各数之间的和有规律，如1、2、3、5、8、13，前两个数相加等于后

一个数。
3)看各数的大小组合规律，作出合理的分组。如 7,9,40,74,1526,5436，7和9，40和74，1526和5436这三

组各自是大致处于同一大小级，那规律就要从组方面考虑，即不把它们看作6个数，而应该看作3个组。而

组和组之间的差距不是很大，用乘法就能从一个组过渡到另一个组。所以7*7-9=40 , 9*9-7=74 , 40*40

-74=1526 , 74*74-40=5436，这就是规律。
4)如根据大小不能分组的，A，看首尾关系，如7，10，9，12，11，14，这组数 7 14＝10 11＝9 12。

首尾关系经常被忽略，但又是很简单的规律。B，数的大小排列看似无序的，可以看它们之间的差与和有

没有顺序关系。
5)各数间相差较大，但又不相差大得离谱，就要考虑乘方，这就要看各位对数字敏感程度了。如6、24、

60、 120、210，感觉它们之间的差越来越大，但这组数又看着比较舒服(个人感觉，嘿嘿)，它们的规律

就是2^3-2=6、3^3-3=24、4^3-4=60、5^3-5=120、6^3-6=210。这组数比较巧的是都是6的倍数，容易导入

歧途。
6)看大小不能看出来的，就要看数的特征了。如21、31、47、56、69、72，它们的十位数就是递增关系，

如 25、58、811、1114 ，这些数相邻两个数首尾相接，且2、5、8、11、14的差为3，如论坛上fjjngs解

答：256，269，286，302，（），2 5 6=13　　　　2 6 9＝17　　　2 8 6＝16　　3 0 2＝5，∵　

256 13＝269　　269 17＝286　　286 16＝302 ∴　下一个数为　302 5＝310。
7)再复杂一点，如 0、1、3、8、21、55，这组数的规律是b*3-a=c，即相邻3个数之间才能看出规律，这

算最简单的一种，更复杂数列也用把前面介绍方法深化后来找出规律。
8)分数之间的规律，就是数字规律的进一步演化，分子一样，就从分母上找规律；或者第一个数的分母和

第二个数的分子有衔接关系。而且第一个数如果不是分数，往往要看成分数，如2就要看成2/1。
数字推理题经常不能在正常时间内完成，考试时也要抱着先易后难的态度。
补充：
1）中间数等于两边数的乘积，这种规律往往出现在带分数的数列中，且容易忽略
　　如1/2、1/6、1/3、2、6、3、1/2

2）数的平方或立方加减一个常数，常数往往是1，这种题要求对数的平方数和立方数比较熟悉
　　如看到2、5、10、17，就应该想到是1、2、3、4的平方加1
　　如看到0、7、26、63，就要想到是1、2、3、4的立方减1
　对平方数，个人觉得熟悉1~20就够了，对于立方数，熟悉1~10就够了，而且涉及到平方、立
　方的数列往往数的跨度比较大，而且间距递增，且递增速度较快

3）A＾2－B＝C　因为最近碰到论坛上朋友发这种类型的题比较多，所以单独列出来
　如数列　5，10，15，85，140，7105
　如数列　5, 6, 19, 17 , 344 , －55　
　如数列　5,　15,　10,　215，－115
　这种数列后面经常会出现一个负数，所以看到前面都是正数，后面突然出现一个负数，就
　考虑这个规律看看

4）奇偶数分开解题，有时候一个数列奇数项是一个规律，偶数项是另一个规律，互相成干扰项
　如数列　1,　8,　9,　64,　25，216
　奇数位1、9、25 分别是1、3、5的平方
　偶数位8、64、216是2、4、6的立方
先补充到这儿。。。。。。

5) 后数是前面各数之各，这种数列的特征是从第三个数开始，呈2倍关系
　如数列：1、2、3、6、12、24
　由于后面的数呈2倍关系，所以容易造成误解！